Home
Giới thiệu
Tài khoản
Đăng nhập
Quên mật khẩu
Đổi mật khẩu
Đăng ký tạo tài khoản
Liệt kê
Công trình khoa học
Bài báo trong nước
Bài báo quốc tế
Sách và giáo trình
Thống kê
Công trình khoa học
Bài báo khoa học
Sách và giáo trình
Giáo sư
Phó giáo sư
Tiến sĩ
Thạc sĩ
Lĩnh vực nghiên cứu
Tìm kiếm
Cá nhân
Nội dung
Góp ý
Hiệu chỉnh lý lịch
Thông tin chung
English
Đề tài NC khoa học
Bài báo, báo cáo khoa học
Hướng dẫn Sau đại học
Sách và giáo trình
Các học phần và môn giảng dạy
Giải thưởng khoa học, Phát minh, sáng chế
Khen thưởng
Thông tin khác
Tài liệu tham khảo
Hiệu chỉnh
Số người truy cập: 107,120,826
A high-pass shaped LMS algorithm based predistortion technique for fractional-N BB-DPLLs
Tác giả hoặc Nhóm tác giả:
Tuan Minh Vo
Nơi đăng:
Microelectronics Journal (Elsevier);
S
ố:
146;
Từ->đến trang
: 106153;
Năm:
2024
Lĩnh vực:
Khoa học công nghệ;
Loại:
Bài báo khoa học;
Thể loại:
Quốc tế
TÓM TẮT
In this paper, we prove that rather than the second-order DS modulator (DSM) as typically believed using the first-order one yields a faster convergence for the linear-piecewise predistortion technique employed in digital/time converter (DTC) based fractional-N Bang-Bang digital phase-locked-loops (BB-DPLLs). We also propose a novel technique that addresses the limit-cycle issue happening in near-integer channels of the conventional BB-DPLLs. With the first-order DSM-based novel technique, simulation results show that the worst fractional spurs are below -
83 dBc at 12 kHz offset frequency assuming the DTC’s integral nonlinearity error is as large as 5 least-significant-bits.
ABSTRACT
In this paper, we prove that rather than the second-order DS modulator (DSM) as typically believed using the first-order one yields a faster convergence for the linear-piecewise predistortion technique employed in digital/time converter (DTC) based fractional-N Bang-Bang digital phase-locked-loops (BB-DPLLs). We also propose a novel technique that addresses the limit-cycle issue happening in near-integer channels of the conventional BB-DPLLs. With the first-order DSM-based novel technique, simulation results show that the worst fractional spurs are below -
83 dBc at 12 kHz offset frequency assuming the DTC’s integral nonlinearity error is as large as 5 least-significant-bits.
© Đại học Đà Nẵng
Địa chỉ: 41 Lê Duẩn Thành phố Đà Nẵng
Điện thoại: (84) 0236 3822 041 ; Email: dhdn@ac.udn.vn